Software prefetching for software pipelined loops

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Para acceder a los documentos con el texto completo, por favor, siga el siguiente enlace: http://hdl.handle.net/2117/105151

Título:	Software prefetching for software pipelined loops
Autor/a:	Sánchez, Jesús; González Colás, Antonio María
Otros autores:	Universitat Politècnica de Catalunya. Departament d'Arquitectura de Computadors; Universitat Politècnica de Catalunya. ARCO - Microarquitectura i Compiladors
Abstract:	The paper investigates the interaction between software pipelining and different software prefetching techniques for VLIW machines. It is shown that processor stalls due to memory dependencies have a great impact into execution time. A novel heuristic is proposed and it is show to outperform previous proposals.
Abstract:	Peer Reviewed
Materia(s):	-Àrees temàtiques de la UPC::Informàtica::Arquitectura de computadors -Software architecture -Prefetching -Delay -Processor scheduling -Pipeline processing -Registers -VLIW -Proposals -Degradation -Argon -Programari -- Disseny
Derechos:
Tipo de documento:	Artículo - Versión publicada Objeto de conferencia
Editor:	Institute of Electrical and Electronics Engineers (IEEE)
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